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HiperLCS死區時間的選取

    絕大部分使用HiperLCS的設計,無論其功率與工作頻率多大,都能以介于290和360 ns之間的死區時間非常好地工作。VBROWNOUT要求較低的設計則需要采用較短的死區時間。HiperLCS器件允許用戶通過設置死區時間和軟啟動等關鍵電路參數來獲得最佳方案,從而達到改進設計的目的     設置死區時間時需要在低壓/滿載(低頻率)和最小負載/高壓(高頻率)條件之間進行折中選擇。低壓/滿載工作具有最優的短死區時間,而最小負載/高壓工作具有最優的長死區時間。 

   設置的死區時間長于低壓/滿載工作的最優的短死區時間時,會產生一部分ZVS損耗,如果在穩態工作期間不出現低壓/滿載工作條件(即只在瞬態條件下出現,如維持時間時出現),這一設置也是可以接受的。在穩態工作期間產生ZVS損耗的工作方式會導致內部功耗,應予以避免。    設置的死區時間短于高壓/最小負載工作的最優的長死區時間時,容易造成反饋信號反向,強制HiperLCS進入脈沖串模式。如果所導致的脈沖串模式工作是可以接受的,這一設置也是可以接受的(亦即,脈沖串的重復頻率不會產生音頻噪聲。而在強信號瞬變時,HiperLCS允許進入和退出脈沖串模式,且此類情況可以接受)。注意,如果前端采用PFC預穩,負載突降(例如,從100%到1%的負載階躍)會使得輸入電壓呈現短暫的瞬態改變(例如,LLC級的輸入電壓從380 V升至410 V,然后相對緩慢地降回到380 V)。另請注意,脈沖串閾值頻率設置是設計師可以用來調節脈沖串模式的另一個變量。

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tanb006
LV.10
2
2022-09-13 23:12

這個是半橋?如果有信號傳給次級就可以做同步整流了。

其實可以這樣做的。

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tabing_dt
LV.10
3
2022-09-16 20:47

更短的死區時間將截斷高壓輕載下的轉換,導致更早出現高頻增益反轉和脈沖串模式工作。

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tabing_dt
LV.10
4
2022-09-16 20:47

HiperLCS器件所具有的高開關頻率可使設計師在輸出環路中使用低成本的SMD陶瓷電容。

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2022-09-16 20:51
@tabing_dt
更短的死區時間將截斷高壓輕載下的轉換,導致更早出現高頻增益反轉和脈沖串模式工作。

這個死區時間設置多少是有講究的,輕載、高壓工作,具有較長的轉換時間且死區時間稍短于最佳值。

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2022-09-16 20:52

對于高效率設計,其諧振控制電路可提供極低的功率損耗,能使設計在66 kHz額定開關頻率下達到97%以上的效率。

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xxbw6868
LV.10
7
2022-09-17 22:49
@眼睛里的海
對于高效率設計,其諧振控制電路可提供極低的功率損耗,能使設計在66kHz額定開關頻率下達到97%以上的效率。

如果成本和尺寸決定設計準則,可優先采用高開關頻率。

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tabing_dt
LV.10
8
2022-09-17 23:00
@眼睛里的海
這個死區時間設置多少是有講究的,輕載、高壓工作,具有較長的轉換時間且死區時間稍短于最佳值。

隨著高壓下負載減小或輕載下電壓增大,頻率將升高,而勵磁電流將減小。

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tabing_dt
LV.10
9
2022-09-17 23:00

PI最新的高散熱效率超薄eSIP-16C封裝有助于進一步節省空間和減小散熱片尺寸。

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2022-09-17 23:04
@xxbw6868
如果成本和尺寸決定設計準則,可優先采用高開關頻率。

在后面這種情況下,仍能實現較高效率,例如在獲得最大功率的頻率250 kHz下效率可達96%。

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2022-09-17 23:04
@tabing_dt
HiperLCS器件所具有的高開關頻率可使設計師在輸出環路中使用低成本的SMD陶瓷電容。

這樣取代體積大、可靠性差的電解電容,同時還可降低所需磁芯的尺寸。

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tabing_dt
LV.10
12
2022-09-18 13:01
@眼睛里的海
在后面這種情況下,仍能實現較高效率,例如在獲得最大功率的頻率250kHz下效率可達96%。

變頻控制器通過零電壓(ZVS)開關功率MOSFET,消除開關損耗,從而達到高效率。

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2022-09-18 13:08
@tabing_dt
隨著高壓下負載減小或輕載下電壓增大,頻率將升高,而勵磁電流將減小。

這樣會增加ZVS轉換時間,當轉換時間開始大于死區時間時,ZVS轉換將被截斷。

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fengxbj
LV.8
14
2022-09-19 18:05
@眼睛里的海
對于高效率設計,其諧振控制電路可提供極低的功率損耗,能使設計在66kHz額定開關頻率下達到97%以上的效率。

電路的死區時間怎么改變了?設計的時候需要預留多久余量合適,避免損壞

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XHH9062
LV.9
15
2022-09-19 19:48

這個需要怎樣去選取

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dy-n66BzSV7
LV.6
16
2022-09-20 23:49

器件死區電壓對傳輸曲線有哪些影響

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dy-nmLUWFNr
LV.8
17
2022-09-21 23:55

死區時間越長是不是會有效提高轉換效率

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dy-nmLUWFNr
LV.8
18
2022-09-22 08:12

是不是死區時間越長工作效率越高

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CDJ01
LV.5
19
2022-09-22 23:28

這種把MOS集成到IC中的LLC如何設計諧振腔呢?電路中也沒看到諧振電感,也是集成的嗎

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2022-09-25 17:38

采用較短的死區時間只能適用于較低的設計要求嗎

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xxbw6868
LV.10
21
2022-12-10 18:30
@dy-nmLUWFNr
死區時間越長是不是會有效提高轉換效率

輸出電壓與輸出電流會隨著死區時間的加入而失真,如果我們選擇過大的死區時間,對于感應電機的情況,系統將會變得不穩定。

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spowergg
LV.10
22
2022-12-10 18:47
@xxbw6868
輸出電壓與輸出電流會隨著死區時間的加入而失真,如果我們選擇過大的死區時間,對于感應電機的情況,系統將會變得不穩定。

選擇死區時間時,一方面應讓它滿足避免橋臂直通的要求,另一方面應讓它盡可能地小,以確保電壓源逆變器能正常工作。

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xxbw6868
LV.10
23
2023-01-15 21:09
@眼睛里的海
這樣取代體積大、可靠性差的電解電容,同時還可降低所需磁芯的尺寸。

HiperLCS的高散熱效率以及使用超薄eSIP-16C封裝有助于進一步節省空間和減小散熱片尺寸,可在750kHz峰值開關頻率下實現出色的變壓器利用率。

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trllgh
LV.10
24
2023-02-20 20:44
@眼睛里的海
對于高效率設計,其諧振控制電路可提供極低的功率損耗,能使設計在66kHz額定開關頻率下達到97%以上的效率。

如果考慮到電源效率,LLC是不錯的選擇。包含PFC在內;比較容易做到整體效率>92%。

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黑夜公爵
LV.10
25
2023-06-08 20:10
@CDJ01
這種把MOS集成到IC中的LLC如何設計諧振腔呢?電路中也沒看到諧振電感,也是集成的嗎

最小直流輸入電壓在最小輸入電壓及最大負載下不低于80VDC

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tmpeger
LV.10
26
2023-09-17 21:44
@眼睛里的海
在后面這種情況下,仍能實現較高效率,例如在獲得最大功率的頻率250kHz下效率可達96%。

傳導干擾信號僅在橋堆二極管導通時才會加到頻譜分析儀或接受機的檢測器上

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2023-09-18 20:54

在穩態工作期間產生ZVS損耗的工作方式會導致內部功耗

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spowergg
LV.10
28
2023-09-18 21:21

在所有正常負載條件下,初級開關都可以工作在零電壓開關(ZVS)條件。

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ehi763
LV.6
29
2023-09-18 21:43
@trllgh
如果考慮到電源效率,LLC是不錯的選擇。包含PFC在內;比較容易做到整體效率>92%。

通過對具有零電壓開關特性的主功率開關以及有源鉗位開關,進行變頻的非互補模式的控制來實現的。

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opingss88
LV.10
30
2023-11-06 22:59
@眼睛里的海
對于高效率設計,其諧振控制電路可提供極低的功率損耗,能使設計在66kHz額定開關頻率下達到97%以上的效率。

多路輸出的設計中,應增加主輸出的輸出電流,一般是有反饋取樣的輸出

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2023-11-07 12:43
@opingss88
多路輸出的設計中,應增加主輸出的輸出電流,一般是有反饋取樣的輸出

對于多路輸出的情況,通常只有輸出電壓低、輸出電流變化范圍大的一路作為主電路進行反饋調節控制,以保證在輸入電壓及負載變化時保持輸出電壓穩定。

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